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IRS21858SPBF
VREF
VSE
HIN1
HIN2
HIN3
HO
HO3
Figure 1B
Logic Truth Table
Input/Output Timing Diagram : HO/HO3 outputs
HIN1
0
0
0
0
1
1
1
1
1
HIN2
0
0
1
1
0
0
1
1
Step(0/1)
HIN3
0
1
0
1
0
1
0
1
1 or 0
OTA of HO
High impedance (HIZ)
High impedance (HIZ)
High impedance (HIZ)
High impedance (HIZ)
Linear ramp rate
controlled by RES1
Linear ramp rate
controlled by RES1
Linear ramp rate
controlled by RES2
Linear ramp rate
controlled by RES2
Stepwise linear
(Dual slope)
Gate driver of HO
0
0
1
1
High impedance
(HIZ)
High impedance
(HIZ)
High impedance
(HIZ)
High impedance
(HIZ)
High impedance
(HIZ)
Gate driver of HO3
0
1
0
1
0
1
0
1
1 or 0
www.irf.com
11
? 2008 International Rectifier
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